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본 발명은 Digital Low Dropout Voltage Regulator(DLDO)의 과도 응답 속도와 출력 안정성을 개선하기 위한 새로운 구조에 관한 것이다. 기존 DLDO 구조에서는 비교기의 성능이 고정되어 과도 응답 속도가 제한되는 문제가 있었다. 본 발명에서는 비교기(Comparator)의 최적 높은 이득점(Optimum High Gain Point)을 적응적으로 보정(Adaptive Calibration)할 수 있는 구조를 제안하여 과도 응답 속도를 개선하고, 안정적인 출력 전압을 유지할 수 있도록 하였다. 또한 아날로그-디지털 변환기(ADC)를 통해 출력 상태를 즉각적으로 감지하고, 이에 따라 기존 방식에서는 1개씩만 조절되던 Coarse pass gate의 개수를 동적으로 조절하여 더욱 빠른 과도 응답 속도를 구현하였다. 이를 통해 DLDO Regulator는 고속 응답과 더불어 출력의 안정성을 동시에 확보할 수 있다.